PowerQUICC®处理器带CPM (1个SCC、1个SMC)、10/100以太网

MPC859DSL

MPC859DSL集成通信控制器结合了多功能片上集成微处理器与外设，适用于多种控制器应用。特别适用于CPE应用，包括DSL调制解调器、IAD和家庭网关。与MPC866类似，MPC859DSL是0.18微米版本的PowerQUICC®系列， MPC8xx内核的运行速率高达66 MHz。它拥有1.8 V内核和3.3 V I/O运行。

MPC859DSL基于Power Architecture，是恩智浦半导体四通道集成通信控制器(PowerQUICC)的衍生产品。MPC859DSL的嵌入式CPU是一个32位处理器(MPC8xx内核)，基于Power Architecture技术，包含存储器管理单元(MMU)和指令与数据缓存。存储控制器支持许多存储器类型，包括SDRAM。通信处理模块（CPM）针对支持快速以太网(MII)、并行ATM (UTOPIA)、UTOPIA II Multi-PHY（最多4个地址）及许多功能的CPE应用。

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特征

  • 单发、32位版本的内核(与Power Architecture技术兼容)，带有32个32位通用寄存器(GPR)
  • 与MPC860SAR相比，MPC859DSL增强了ATM功能。859DSL增加了在“增强型SAR”(ESAR)模式下可用的主要新功能，如下所示：
    • 提供多个APC优先级，支持广泛的流量速度要求
    • 端口到端口切换功能，无需基于RAM的微代码
    • MII (100Base-T)和UTOPIA (半双工)并行功能
    • SPI和I2C的RAM参数可重新定位，无需基于RAM的微代码
    • 支持通过分割总线进行全双工UTOPIA主站(ATM侧)操作
  • 最高32位数据总线(提供8位、16位和32位动态总线调节)
  • UTOPIA端口最多支持4个PHY地址
  • 全静态设计
  • 存储控制器(8个bank)
  • 通用定时器
  • 快速以太网控制器(FEC)
  • 系统集成单元(SIU)
  • 中断
  • 通信处理器模块(CPM)
  • 4个波特率发生器
  • 一个用于以太网的串行通信控制器(SCC1)
  • 一个用于UART的串行管理通道(SMC1)
  • 一个串行外设接口(SPI)
  • 一个I2C (内部集成电路)端口
  • 并行接口端口(PIP)
  • 一个PCMCIA插槽(B端口)
  • 低功耗支持
  • 调试接口
  • 1.8 V内核，3.3 V I/O
  • 357引脚PBGA封装

对比表

MPC866系列版本和掩码

四路 工艺 掩码 IMMR [16:31]
修订版0.3 MC HiP6W 3L90H 0x0800
修订版A.0 MC HiP6W 0L96R 0x0801
注1：此处nn = 50、66、100或133

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